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标题 一种基于时序逻辑电路的延时开关设计
范文 冯家鹏
摘 要:时序逻辑电路设计是《数字电子技术》课程中一个难度大、综合性高的部分,它综合了组合逻辑电路和时序逻辑电路的内容。在进行状态机设计时,随着输入逻辑变量的增加,状态数目将呈指数倍急剧增加,这会使整个设计变得复杂且容易出错。以一个延时开关控制器的设计为例,提出了一种状态机输入变量简化的方法,降低了设计过程的复杂程度。
关键词:时序逻辑电路; 延时开关; 状态机化简; D触发器
中图分类号:TN79-34 文献标识码:A 文章编号:1004-373X(2011)15-0177-02
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更新时间:2025/3/23 0:16:10