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标题 基于FPGA的DDS+DPLL跳频信号源设计
范文 杨红 李海 隆行
摘 要:针对跳频通信系统有固有噪声的特点,结合DDS+DPLL高分辨率、高频率捷变速度的优点,并采用Altera公司的Quartus并騙10.1软件进行设计综合,提出了一种新型的跳频信号源。结果表明,该设计中DPLL时钟可达到120 MHz,性能较高,而仅使用了30个 LUT和18个触发器,占用资源很少。
关键词:数字鉴相器; 滤波器; 数控振荡器; DPLL
中图分类号:TN911-34 文献标识码:A 文章编号:1004-373X(2011)15-0101-04
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更新时间:2025/2/11 7:24:50